Domina SystemVerilog — Curso en inglés: ¡Aprende con proyectos prácticos y conviértete en ingeniero de verificación!

Este curso ofrece una experiencia completamente práctica para dominar SystemVerilog orientado al diseño y verificación VLSI. Está pensado para estudiantes, recién graduados y aspirantes a ingenieros de RTL/Design Verification que desean pasar de la teoría a la práctica con ejemplos y proyectos reales.

A lo largo del curso trabajarás con fundamentos y sintaxis de SystemVerilog, técnicas de diseño RTL, construcción de testbenches eficientes, uso de assertions y conceptos básicos de UVM (Universal Verification Methodology). Además, realizarás proyectos como ALU, FIFO, UART y FSM, y aprenderás a simular y depurar usando herramientas y visualizadores de formas de onda.

El enfoque es práctico y orientado a la industria: usarás herramientas como ModelSim, QuestaSim, Vivado, VS Code, EDA Playground y GTKWave para obtener experiencia real en flujos de diseño y verificación, y salir con habilidades listas para el mercado laboral.

Lo que aprenderás:

• Comprender los fundamentos y la sintaxis de SystemVerilog
• Diseñar bloques RTL usando buenas prácticas de SystemVerilog
• Construir testbenches escalables y eficientes para verificación
• Aplicar assertions y técnicas de verificación modernas
• Introducción práctica a UVM y cómo estructurar entornos de verificación
• Desarrollar y verificar proyectos reales: ALU, FIFO, UART y FSM
• Simular y depurar diseños usando ModelSim, QuestaSim y Vivado
• Analizar formas de onda con GTKWave y mejorar el flujo de depuración
• Usar VS Code y EDA Playground para desarrollo y pruebas rápidas
• Adquirir habilidades prácticas listas para roles de diseño y verificación en la industria

Contenido del curso:

• Secciones: 12
• Clases: 85
• Duración: 10 horas aprox.

Requisitos:

• Conocimientos en Electrónica Digital
• Conocimientos de Verilog HDL

¿Para quién es este curso?

• Principiantes con conocimientos en diseño digital que desean entrar en verificación
• Estudiantes de ECE/EEE y aspirantes a roles de RTL/Design Verification

¿Qué esperas para comenzar?

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